Cours Circuits logiques séquentiels

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Plan de cours

• Circuits logiques séquentiels
• Éléments de mémoire 
• Délai de propagation des portes logiques 
• Phénomène de mémoire 
• Circuit bistable SR 
• Bistable SR avec signal d’activation
• Bistable D 
• Bascule D de type maître esclave
• Bascule D 
• Bascule T
• Machine à états finis 
• Machine de Moore et Mealy 
• Convertir une Machine de Moore en Mealy 
• Circuits séquentiels synchrones
• Conception d’une machine de Moore
• Conception d’une machine de Mealy 
• États redondants
• Implémentation avec bascule JK et T 

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1,630.28 Kb

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Publié le:

2017-12-21 22:35:48